供應AD9652BBCZ-310
發布時間:2019/7/6 11:27:00 訪問次數:192 發布企業:深圳市晶美隆科技有限公司
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特性
1.8 V模擬供應操作
1.8 V CMOS或LVDS輸出供應
信噪比
82 dBFS 30 MHz輸入和105年議員數據率
83 dBFS 9.7 MHz輸入和25名議員數據率
SFDR
90 dBc 30 MHz輸入和105年議員數據率
95 dBc 9.7 MHz輸入和25名議員數據率
低功率
每通道105議員328兆瓦
119兆瓦每通道25議員
整數1至8輸入時鐘分頻器
如果采樣頻率為300 MHz
模擬輸入范圍為2.7 V p p
可選片上猶豫
集成ADC取樣保持的輸入
微分模擬輸入500 MHz帶寬
ADC時鐘工作周期穩定劑
原理框圖
AVDD
SDIO SCLK /
DCS
DFS
SPI
CSB
DRVDD
AD9650
編程的數據
VIN +一個
VIN-A
ADC
16
CMOS / LVDS
輸出緩沖區
奧拉
D15A (MSB)
來
D0A (LSB)
CLK +
CLK -
VREF
感覺
裁判
選擇
分1
到8
工作周期
穩定劑
DCO
一代
DCOA
DCOB
ORB
VCM
RBIAS
VIN-B
VIN + B
ADC
多片
同步
16
CMOS / LVDS
輸出緩沖區
D15B (MSB)
來
D0B (LSB)
應用程序
工業自動化儀表
x射線、MRI和超聲設備
高速脈沖采集
化學和光譜分析
直接轉換接收器
多模數字接收機
智能天線系統
通用軟件無線電
圖1所示。
靈活的省電選項允許較大的電能節約,
當所需的。
編程設置和控制是使用電話來完成的
SPI-compatible串行接口。
AD9650可用以64 -鉛LFCSP和指定
的工業溫度范圍−40°C + 85°C。
一般的描述
AD9650是雙重16位25議員/ 65議員/ 80議員/
105年議員模擬-數字轉換器(ADC)設計
數字化頻率高、寬動態范圍的信號
輸入頻率300 MHz。
多級雙ADC核心特性,微分管線式
體系結構與集成的輸出誤差修正邏輯。 每一個
寬的帶寬,ADC特性微分取樣保持的
模擬輸入放大器、集成和共享的參考電壓,
簡化了設計上的考慮。 工作周期穩定劑
提供補償ADC時鐘義務的變化
循環,使轉換器保持性能優良。
ADC的輸出可以直接路由到兩個外部數據
16位輸出端口或多路復用總線上一個16位。 這些
輸出可以設置為1.8 V CMOS或LVDS。
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