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XC6SLX150-2CSG484I高端物料專業供應商

發布時間:2019/8/26 15:36:00 訪問次數:161

Spartan-6系列提供了領先的系統集成功能,為大容量應用程序提供了最低的總成本。這個由13人組成的家族提供了從3,840到147,443個邏輯單元的擴展密度,其耗電量是以前斯巴達家族的一半,而且連接速度更快,更全面。建立在一個成熟的45納米低功率銅工藝技術,提供最佳的成本,電力和性能的平衡,斯巴達-6系列提供了一個新的,更有效的雙寄存器6輸入查找表(LUT)邏輯和豐富的選擇內建系統級別的塊。其中包括18 KB(2x9 KB)塊RAMS、第二代DSP48A1片、SDRAM存儲器控制器、增強混合模式時鐘管理塊、SelectIO技術、功率優化的高速串行收發器塊、PCI Express兼容的端點塊、先進的系統級電源管理模式、自動檢測配置選項,以及通過AES和設備DNA保護增強IP安全性。這些功能為定制ASIC產品提供了一種低成本、可編程的替代品,具有前所未有的易用性。Spartan-6FPGAs為大容量邏輯設計、面向消費者的DSP設計和成本敏感的嵌入式應用提供了最佳解決方案.Spartan-6FPGAs是目標設計平臺的可編程硅基礎,該平臺提供集成的軟硬件組件,使設計師能夠在開發周期一開始就專注于創新。

技術參數 斯巴達-6 lx fpga:邏輯優化 為低成本而設計的 多有效集成塊 I/O標準的優化選擇 交錯墊 大容量塑料線材包裝 低靜、動態功率 45 nm工藝優化成本和低功耗 零功耗的Hibernate下電模式 掛起模式保持狀態和配置,多引腳喚醒,控制增強。 多電壓多標準SelectIO™接口組 每次差分I/O的數據傳輸速率高達1,080 Mb/s 可選擇輸出驅動器,每針可達24 mA 3.3V至1.2V I/O標準和協議 低成本的hstl和sstl內存接口 熱交換遵從性 可調I/O轉換速率以提高信號完整性 lxt fpga中的高速gtp串行收發器 高達3.2GB/s 高速接口包括:串行ATA、Aurora、1G以太網、PCI Express、OBSAI、CPRI、EPON、GPON、DisplayPort和XAUI。 用于PCI Express設計的集成端點塊(LXT) 符合33 MHz、32位和64位規范的低成本PCI技術支持。 高效DSP48A1切片 高性能算法與信號處理 快速18x18乘法器和48位累加器 流水線和級聯能力 預加法器輔助濾波應用 集成存儲器控制器塊 DDR、DDR 2、DDR 3和LPDDR支持 數據速率高達800 MB/s(12.8GB/s峰值帶寬) 采用獨立FIFO的多端口總線結構減少設計時序問題 邏輯容量增加,邏輯資源豐富 可選移位寄存器或分布式RAM支持 高效的6輸入LUTS提高性能和最小化功率 用于管道中心應用的雙觸發器的lut 粒度范圍廣的塊RAM 具有字節寫啟用功能的快速塊RAM 18 KB塊,可以可選地作為兩個獨立的9 KB塊Rams編程 提高性能的時鐘管理Tile(CMT) 低噪聲,柔性時鐘 數字時鐘管理器(DCMS)消除了時鐘偏差和占空比失真。 用于低抖動時鐘的鎖相環 同時乘法、除法和相移的頻率合成 16個低斜率全球時鐘網絡 簡化配置,支持低成本標準。 2引腳自動檢測配置 廣泛的第三方spi(最多x4)和NOR閃存支持 功能豐富的Xilinx平臺Flash與JTAG 多引導支持多比特流遠程升級,使用看門狗保護 加強設計保護的安全性 用于設計認證的唯一設備DNA標識符 較大設備中的AES比特流加密 具有增強的、低成本的MicroBlaze™軟處理器的更快的嵌入式處理 業界領先的ip和參考設計

Spartan-6系列提供了領先的系統集成功能,為大容量應用程序提供了最低的總成本。這個由13人組成的家族提供了從3,840到147,443個邏輯單元的擴展密度,其耗電量是以前斯巴達家族的一半,而且連接速度更快,更全面。建立在一個成熟的45納米低功率銅工藝技術,提供最佳的成本,電力和性能的平衡,斯巴達-6系列提供了一個新的,更有效的雙寄存器6輸入查找表(LUT)邏輯和豐富的選擇內建系統級別的塊。其中包括18 KB(2x9 KB)塊RAMS、第二代DSP48A1片、SDRAM存儲器控制器、增強混合模式時鐘管理塊、SelectIO技術、功率優化的高速串行收發器塊、PCI Express兼容的端點塊、先進的系統級電源管理模式、自動檢測配置選項,以及通過AES和設備DNA保護增強IP安全性。這些功能為定制ASIC產品提供了一種低成本、可編程的替代品,具有前所未有的易用性。Spartan-6FPGAs為大容量邏輯設計、面向消費者的DSP設計和成本敏感的嵌入式應用提供了最佳解決方案.Spartan-6FPGAs是目標設計平臺的可編程硅基礎,該平臺提供集成的軟硬件組件,使設計師能夠在開發周期一開始就專注于創新。

技術參數 斯巴達-6 lx fpga:邏輯優化 為低成本而設計的 多有效集成塊 I/O標準的優化選擇 交錯墊 大容量塑料線材包裝 低靜、動態功率 45 nm工藝優化成本和低功耗 零功耗的Hibernate下電模式 掛起模式保持狀態和配置,多引腳喚醒,控制增強。 多電壓多標準SelectIO™接口組 每次差分I/O的數據傳輸速率高達1,080 Mb/s 可選擇輸出驅動器,每針可達24 mA 3.3V至1.2V I/O標準和協議 低成本的hstl和sstl內存接口 熱交換遵從性 可調I/O轉換速率以提高信號完整性 lxt fpga中的高速gtp串行收發器 高達3.2GB/s 高速接口包括:串行ATA、Aurora、1G以太網、PCI Express、OBSAI、CPRI、EPON、GPON、DisplayPort和XAUI。 用于PCI Express設計的集成端點塊(LXT) 符合33 MHz、32位和64位規范的低成本PCI技術支持。 高效DSP48A1切片 高性能算法與信號處理 快速18x18乘法器和48位累加器 流水線和級聯能力 預加法器輔助濾波應用 集成存儲器控制器塊 DDR、DDR 2、DDR 3和LPDDR支持 數據速率高達800 MB/s(12.8GB/s峰值帶寬) 采用獨立FIFO的多端口總線結構減少設計時序問題 邏輯容量增加,邏輯資源豐富 可選移位寄存器或分布式RAM支持 高效的6輸入LUTS提高性能和最小化功率 用于管道中心應用的雙觸發器的lut 粒度范圍廣的塊RAM 具有字節寫啟用功能的快速塊RAM 18 KB塊,可以可選地作為兩個獨立的9 KB塊Rams編程 提高性能的時鐘管理Tile(CMT) 低噪聲,柔性時鐘 數字時鐘管理器(DCMS)消除了時鐘偏差和占空比失真。 用于低抖動時鐘的鎖相環 同時乘法、除法和相移的頻率合成 16個低斜率全球時鐘網絡 簡化配置,支持低成本標準。 2引腳自動檢測配置 廣泛的第三方spi(最多x4)和NOR閃存支持 功能豐富的Xilinx平臺Flash與JTAG 多引導支持多比特流遠程升級,使用看門狗保護 加強設計保護的安全性 用于設計認證的唯一設備DNA標識符 較大設備中的AES比特流加密 具有增強的、低成本的MicroBlaze™軟處理器的更快的嵌入式處理 業界領先的ip和參考設計

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