深圳市大唐盛世半導體有限公司
手 機：17727572380 （程R)。13008842056(張R)
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EV8AQ160 ： 四位模數轉換器。公司優勢庫存。
數據表
主要特點
•具有8位分辨率的四通道ADC
–四通道模式下的1.25 Gsps采樣率
–兩通道模式下的2.5 Gsps采樣率
–單通道模式下的5 Gsps采樣率
–內置四乘四交叉點開關
•需要2.5 GHz差分對稱輸入時鐘
•ADC主復位（LVDS）
•雙倍數據速率輸出協議
•LVDS輸出格式
•帶復位信號的數字接口（SPI）
–可選的1：1或1：2多路分解輸出
–頻道模式選擇
– 500 mVpp或625 mVpp模擬輸入（差分AC或DC
耦合）
–可選帶寬（四個可用設置）
–增益控制（±18％）
–失調控制（±50 mV）
–相位控制（±14 ps范圍）
–待機模式（完全或部分）
–二進制或灰色編碼選擇
- 測試模式
•電源：3.3V和1.8V（輸出），1.8V（數字）
•功耗：總計4.2W（1：1 DMUX模式）
•EBGA380封裝（RoHS，1.27毫米間距）
性能
•高達2 GHz的可選全功率輸入帶寬（–3 dB）（4- / 2- / 1通道模式）
•通道間隔離度：> 60 dB
•四通道模式（采樣= 1.25 Gsps，–1 dBFS）
– Fin = 100 MHz：ENOB = 7.5位，SFDR = 58 dBc，SNR = 46.5 dBc，DNL =±0.18 LSB，INL =±0.4 LSB
– Fin = 620 MHz：ENOB = 7.3位，SFDR = 56 dBc，SNR = 45 dBc
•兩通道模式（Fsampling = 2.5 Gsps，–1 dBFS）
– Fin = 100 MHz：ENOB = 7.5位，SFDR = 58 dBc，SNR = 46 dBc，DNL =±0.14 LSB，INL =±0.35 LSB
– Fin = 620 MHz：ENOB = 7.2位，SFDR = 56 dBc，SNR = 44.5 dBc
•單通道模式（采樣= 5 Gsps，鰭= 100 MHz，–1 dBFS）
– Fin = 100 MHz：ENOB = 7.4位，SFDR = 58 dBc，SNR = 46 dBc，DNL =±0.12 LSB，INL =±0.27 LSB
– Fin = 620 MHz：ENOB = 7.1位，SFDR = 56 dBc，SNR = 44 dBc
•BER：全速10–16
篩選•封裝設備的溫度范圍
•商業級C：0°C <Tamb <70°C
應用程序•高速示波器
描述
Quad ADC由四個8位ADC內核構成，可以獨立考慮（四個通道
模式）或按兩個內核分組（兩通道模式，ADC交織為二乘二或
單通道模式，其中所有四個ADC都交織）。
所有四個ADC均由相同的外部輸入時鐘信號提供時鐘，并通過SPI（串行
外圍接口）。模擬多路復用器（交叉點開關）用于選擇模擬輸入
取決于使用Quad ADC的模式。
時鐘電路是所有四個ADC共用的。該模塊接收一個外部2.5 GHz時鐘（最大
頻率），最好是低抖動對稱信號。在此模塊中，外部時鐘信號為
除以二以生成內部采樣時鐘：
•在四通道模式下，將相同的1.25 GHz時鐘定向到所有四個ADC內核和T / H
•在兩通道模式下，同相1.25 GHz時鐘發送到ADC A或C，反相1.25 GHz發送到ADC A或C。
時鐘發送到ADC B或D，而模擬輸入發送到兩個ADC，導致交錯
模式，等效采樣頻率為2.5 Gsps
•在單通道模式下，同相1.25 GHz時鐘發送到ADC A，而反相1.25 GHz
時鐘發送到ADC B，同相1.25 GHz時鐘延遲90°以生成ADC時鐘
C和1.25 GHz倒相時鐘延遲90°來生成ADC D的時鐘，從而產生一個
交錯模式，等效采樣頻率為5 Gsps
該時鐘電路中包括對采樣延遲和相位的一些調整，以確保
由2.5 GHz時鐘內部產生的不同時鐘之間的適當相位關系。
交叉點開關（模擬MUX）是所有ADC通用的。它允許選擇具有
由用戶選擇：
•在四通道模式下，每個模擬輸入都發送到相應的ADC（AAI至ADC A，BAI至
ADC B，CAI到ADC C以及DAI到ADC D）
•在兩通道模式下，可以考慮有兩個由ADC A組成的獨立ADC
B用于第一個，而ADC C和D用于第二個。可以應用兩個模擬輸入
在第一個ADC的AAI或BAI上（在這種情況下，信號在內部重定向到第二個ADC
對，分別是B或A）以及在CAI或DAI上（在這種情況下，信號將被重定向）
在該對的第二個ADC內部，分別是D或C）
•在單通道模式下，從AAI，BAI，CAI和DAI中選擇一個模擬輸入，然后發送給所有四個ADC
