一般說明：ADSP-21375KSWZ-2B
ADSP-21371/ADSP-21375KSWZ-2BSHARC® 處理器是 SIMD SHARC 系列 DSP 的成員，具有模擬設備的超級哈佛架構。處理器是源代碼與 ADSP-2126x、ADSP-2136x 和
ADSP-2116x DSP，以及第一代 ADSP-2106xSISD 中的 SHARC 處理器（單指令、單數據）模式。這些處理器是針對高性能汽車音頻進行了優化的 32 位/40 位浮點處理器具有大型片上 SRAM 和掩模可編程 ROM、多條內部總線以消除 I/O 的應用瓶頸和創新的數字應用界面（戴）。如第 1 頁的功能框圖所示，處理器使用兩個計算單元來提供顯著的與以前的 SHARC 處理器相比，性能提高DSP算法的范圍。采用最先進的技術制造，高速度，CMOS工藝，處理器實現指令
266 MHz 時的周期時間為 3.75 ns。憑借其 SIMD 計算硬件，處理器可以執行 1.596 GFLOPS 運行在 266 兆赫。
表 1 顯示了這些設備的性能基準。
表 2 顯示了各個產品的功能。
第 1 頁上的圖表顯示了兩個時鐘域，它們使了 ADSP-2137x 處理器。核心時鐘域包含以下特點：ADSP-21375KSWZ-2B
• 兩個處理元素，每個元素都包含一個ALU、乘法器、移位器和數據寄存器文件
• 數據地址生成器（DAG1、DAG2）
• 帶有指令緩存的程序定序器
• 能夠支持四個 32 位數據的 PM 和 DM 總線在每個核心處理器周期在內存和核心之間傳輸
• 一個帶引腳排列的周期性間隔定時器
• 片上 SRAM（1M 位，ADSP-21371；0.5M 位，ADSP-21375)
• 片上掩模可編程ROM（4M 位，ADSP-21371；2M 位，ADSP-21375)
• JTAG 測試訪問端口，用于仿真和邊界掃描。JTAG 通過允許靈活異常處理的用戶斷點提供軟件調試。第 1 頁上的圖表還顯示了外圍時鐘域（也稱為 I/O 處理器）并包含以下內容
特征：ADSP-21375KSWZ-2B
• IOD0（外設 DMA）和 IOD1（外部端口 DMA）用于 32 位數據傳輸的總線
• 用于核心連接的外圍和外部端口總線
• 數字應用接口，包括四個精度時鐘發生器（PCG），一個S / PDIF兼容的數字音頻接收器/發送器，一個輸入數據端口（IDP），八個串行端口，八個串行接口，一個 20 位并行輸入端口（PDAP）和靈活的信號路由單元（DAI SRU）。
• 數字外設接口，包括兩個定時器，一個UART，兩個串行外圍接口 (SPI)，一個 2 線接口（TWI），以及一個靈活的信號路由單元(DPI SRU)。ADSP-21375KSWZ-2B
• 帶有 AMI 和 SDRAM 控制器的外部端口
• 四個用于 PWM 控制的單元
• 一個用于內部到內部存儲器傳輸的 MTM
SHARC家族核心架構：ADSP-21375KSWZ-2B
ADSP-21371/ADSP-21375 處理器代碼兼容
在裝配級使用 ADSP-2136x、ADSP-2126x、
ADSP-21160x 和 ADSP-21161N，以及第一代
ADSP-2106x SHARC 處理器。 ADSP-21371/
ADSP-21375 處理器與
ADSP-2126x、ADSP-2136x 和 ADSP-2116x SIMD SHARC
處理器，如圖 2 所示，詳細信息如下
部分。ADSP-21375KSWZ-2B
SIMD 計算引擎
處理器包含兩個計算處理元件
作為單指令多數據（SIMD）運行
引擎。處理元素被稱為 PEX 和
PEY，每個都包含一個 ALU、乘法器、移位器和寄存器
文件。 PEX 始終處于活動狀態，PEY 可以通過設置
MODE1 寄存器中的 PEYEN 模式位。當這種模式是
啟用后，在兩個處理元件中執行相同的指令，但每個處理元件對不同的數據進行操作。
這種架構在執行數學密集型 DSP 時非常有效
算法。ADSP-21375KSWZ-2B
進入 SIMD 模式還會影響數據在內存和處理元件之間的傳輸方式。當在
SIMD模式，需要兩倍的數據帶寬來維持
處理元件中的計算操作。因為
這一要求，進入 SIMD 模式也會使內存和處理元件之間的帶寬加倍。什么時候
使用 DAG 在 SIMD 模式下傳輸數據，兩個數據值
每次訪問內存或寄存器文件時都會傳輸。
獨立的并行計算單元
在每個處理元件內是一組計算單元。
計算單元由算術/邏輯單元組成
(ALU)、乘法器和移位器。這些單元在一個周期內執行所有操作。每個處理內的三個單元
元素并行排列，最大限度地提高計算量
吞吐量。單條多功能指令并行執行
ALU 和乘法運算。在 SIMD 模式下，并行
ALU 和乘法器運算發生在兩個處理元件中。這些計算單元支持 IEEE 32 位單精度浮點、40 位
擴展精度浮點和 32 位定點數據格式。
數據寄存器文件：ADSP-21375KSWZ-2B
每個處理單元都包含一個通用數據寄存器文件。寄存器文件在計算之間傳輸數據
單元和數據總線，并存儲中間結果。這些
10 端口、32 寄存器（16 個主要，16 個輔助）寄存器文件，
結合 SHARC 的增強型哈佛架構，
允許計算單元之間不受約束的數據流和
內部存儲器。 PEX 中的寄存器稱為
R0–R15，在 PEY 中為 S0–S15。
上下文切換ADSP-21375KSWZ-2B
許多處理器的寄存器都有輔助寄存器
可以在中斷服務期間激活以實現快速上下文
轉變。寄存器文件中的數據寄存器，DAG 寄存器，
乘法結果寄存器都有二級寄存器。
主寄存器在復位時處于活動狀態，而輔助寄存器
寄存器由模式控制寄存器中的控制位激活。
通用寄存器
通用寄存器可用于通用任務。這
USTAT (4) 寄存器允許簡單的位操作（設置、清除、
切換、測試、異或）的所有系統寄存器（控制/狀態）
核心。ADSP-21375KSWZ-2B
數據總線交換寄存器 PX 允許數據通過
在 64 位 PM 數據總線和 64 位 DM 數據總線之間，或
在 40 位寄存器文件和 PM 數據總線之間。這些寄存器包含處理數據寬度差異的硬件。
定時器ADSP-21375KSWZ-2B
處理器包含一個核心定時器，可以產生周期性的
軟件中斷。核心定時器可以配置為使用
FLAG3 作為定時器到期信號。
一條指令和四個操作數的單周期取指
該處理器具有增強的哈佛架構
數據存儲器 (DM) 總線傳輸數據，程序存儲器 (PM) 總線傳輸指令和數據
（見圖 2）。使用處理器的獨立程序和數據
內存總線和片上指令緩存，處理器可以
同時獲取四個操作數（每個數據總線上兩個）
和一條指令（來自緩存），所有這些都在一個周期內。
指令緩存ADSP-21375KSWZ-2B
處理器包括一個片上指令高速緩存，
使三總線操作用于獲取指令和四個
數據值。緩存是選擇性的——只有那些
與 PM 總線數據訪問發生沖突的提取被緩存。這個
緩存允許全速執行核心循環操作
例如數字濾波器乘法累加和 FFT 蝶形
加工。ADSP-21375KSWZ-2B
具有零開銷硬件的數據地址生成器
循環緩沖區支持
使用處理器的兩個數據地址生成器 (DAG)
用于間接尋址和實現循環數據緩沖區
在硬件中。圓形緩沖器允許高效編程
數字信號所需的延遲線和其他數據結構
處理，并常用于數字濾波器和傅里葉
變換。這兩個 DAG 包含足夠的寄存器以允許
最多可創建 32 個循環緩沖區（16 個主寄存器組，
16 中學）。 DAG 自動處理地址指針
環繞、減少開銷、提高性能并簡化實施。循環緩沖區可以在任何位置開始和結束
內存位置。ADSP-21375KSWZ-2B
靈活的指令集
48位指令字可容納多種并行
操作，用于簡潔的編程。例如，處理器可以有條件地執行乘法、加法和減法
在兩個處理元素中同時分支和獲取
來自內存的四個 32 位值——全部在一條指令中。
片上存儲器ADSP-21375KSWZ-2B
ADSP-21371 處理器包含 1 兆位內部 RAM
和 4 兆位的內部掩碼可編程 ROM（見
第 6 頁的表 3）和 ADSP-21375 處理器包含 0.5
兆位內部 RAM 和 2 兆位內部掩碼可編程 ROM（參見第 7 頁上的表 4）。每個塊都可以
配置為代碼和數據存儲的不同組合。
每個內存塊都支持單周期、獨立訪問
由核心處理器和 I/O 處理器組成。處理器的內存架構與其獨立的片上總線相結合，
允許來自內核的兩次數據傳輸和一次來自 I/O 的數據傳輸
處理器，在一個周期內。
ADSP-21371 處理器的 SRAM 可配置為
最多 32k 字的 32 位數據， 64k 字的 16 位數據，
48 位指令（或 40 位數據）的 21.3k 字，或高達 1 兆位的不同字長的組合。所有的記憶
可以作為 16 位、32 位、48 位或 64 位字訪問。一個 16-
支持位浮點存儲格式，有效地
可存儲在芯片上的數據量翻倍。 32 位浮點數和 16 位浮點數之間的轉換
格式在單個指令中執行。雖然每個內存塊都可以存儲代碼和數據的組合，但訪問是
當一個塊使用 DM 總線存儲數據時效率最高
傳輸，另一個塊使用存儲指令和數據
用于傳輸的 PM 總線。
使用 DM 總線和 PM 總線，其中一個總線專用于
內存塊，確保兩個數據的單周期執行
噸ADSP-21375KSWZ-2B
轉讓。 在這種情況下，指令必須在
緩存。
片上內存帶寬
內部存儲器架構允許在四個訪問
假設沒有塊沖突，同時到四個塊中的任何一個。 總帶寬通過 DMD 和 PMD 總線獲得
（2 64 位，核心 CLK）和 IOD0/1 總線（2 32 位，
PCLK）。ADSP-21375KSWZ-2B
基于 ROM 的安全性
處理器具有 ROM 安全功能，通過防止
啟用時未經授權讀取內部代碼。
使用此功能時，處理器不會引導加載任何
概括：ADSP-21375KSWZ-2B
高性能 32 位/40 位浮點處理器
針對高性能音頻處理進行了優化
單指令多數據 (SIMD) 計算
建筑學ADSP-21375KSWZ-2B
片上存儲器，ADSP-21371—1M 位片上 SRAM
和 4M 位片上掩模可編程 ROM
片上存儲器，ADSP-21375—0.5M 位片上
SRAM 和 2M 位片上掩模可編程 ROM
代碼與 SHARC 系列的所有其他成員兼容
該 ADSP-21371/ADSP-21375 處理器可與
200/266 MHz 核心指令速率，具有獨特的以音頻為中心的外圍設備，例如數字應用接口，
S/PDIF 收發器、串行端口、精密時鐘發生器、
和更多。如需完整的訂購信息，請參閱第 56 頁的訂購指南。
專用音頻組件ADSP-21375KSWZ-2B
ADSP-21371—S/PDIF 兼容的數字音頻
接收器/發射器
ADSP-21371—8 個雙數據線串行端口，最高運行
每條數據線最高 33 Mbps — 每條數據線都有一個時鐘、幀
同步，以及可以配置為任一數據線
接收器或發射器對ADSP-21375KSWZ-2B
16 個 PWM 輸出配置為四組四輸出
基于 ROM 的安全功能包括
使用 64 位密鑰允許 JTAG 訪問內存
可以分配限制的受保護內存區域
在程序控制下訪問敏感代碼
PLL 具有多種軟件和硬件乘法器/除法器比率
采用 208 引腳 LQFP_EP 封裝
制造商: Analog Devices Inc.
產品種類: 數字信號處理器和控制器 - DSP, DSC
RoHS: 詳細信息
產品: DSPs
系列:ADSP-21375KSWZ-2B
商標名: SHARC
安裝風格: SMD/SMT
封裝 / 箱體: LQFP-208
核心: SHARC
內核數量: 1 Core
最大時鐘頻率: 266 MHz
L1緩存指令存儲器: -
L1緩存數據存儲器: -
程序存儲器大小: 512 kB
數據 RAM 大小: 64 kB
工作電源電壓: 1.14 V to 1.26 V
最小工作溫度: 0 C
最大工作溫度: + 70 C
封裝: Tray
商標: Analog Devices
數據總線寬度: 32 bit
數據 ROM 大小: 2 MB
高度: 1.4 mm
長度: 28 mm
濕度敏感性: Yes
輸入/輸出端數量: 16 I/O
計時器/計數器數量: 2 Timer
產品類型: DSP - Digital Signal Processors & Controllers
工廠包裝數量: 36
子類別: Embedded Processors & Controllers
寬度: 28 mm
單位重量: 2.587 g
以下物料均有現貨庫存：ADSP-21375KSWZ-2B
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ADSP-21375KSWZ-2B
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以下物料均有現貨庫存：
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