深圳市大唐盛世半導體有限公司

手 機：17727572380（程R) 。13008842056(張R）

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EP3C80F780C7N ： FPGA - 現場可編程門陣列。原裝現貨。

可編程邏輯器件 (PLD)，在單個器件中提供低成本的可編程芯片系統 (SOPC) 集成
用于實現宏功能的增強型嵌入式陣列
例如高效的內存和專門的邏輯功能
每個嵌入式陣列具有高達 16 位寬度的雙端口功能塊（EAB）
用于通用邏輯功能的邏輯陣列
高密度
10,000 到 100,000 個典型門（見表 1）
高達 49,152 RAM 位（每個 EAB 4,096 位，所有這些都可以
在不降低邏輯容量的情況下使用）
用于大批量生產的經濟高效的可編程架構
應用
成本優化的過程
高性能通信的低成本解決方案
應用
系統級功能
MultiVoltTM I/O 引腳可以驅動或由 2.5-V、3.3-V 或5.0V 器件
低功耗
雙向 I/O 性能（設置時間 [tSU] 和時鐘到輸出延遲 [tCO]）高達 250 MHz
完全符合外圍組件互連
使用 2.5V 內部電源電壓運行
通過外部配置實現在線可重構性 (ICR)
設備、智能控制器或 JTAG 端口
用于減少時鐘延遲的 ClockLockTM 和 ClockBoostTM 選項，時鐘偏移和時鐘倍頻
內置的低偏差時鐘分布樹
所有設備的 100% 功能測試；測試向量或掃描鏈
不需要
在配置之前和配置期間上拉 I/O 引腳
靈活互連
FastTrack® 互連連續路由結構，用于快速、
可預測的互連延遲
實現算術功能的專用進位鏈，例如
作為快速加法器、計數器和比較器（由自動使用
軟件工具和宏功能）
實現高速的專用級聯鏈，
高扇入邏輯功能（由軟件工具自動使用）
和宏功能）
實現內部三態總線的三態仿真
多達六個全局時鐘信號和四個全局清除信號
強大的 I/O 引腳
每個引腳的獨立三態輸出使能控制
每個 I/O 引腳上的開漏選項
可編程輸出壓擺率控制以減少切換
噪音
鉗位到 VCCIO 用戶可以逐個引腳選擇支持熱插拔