描述：5M160ZT100C5N
MAX® V 系列低成本和低功耗 CPLD 提供更高的密度和 I/O每個封裝與其他 CPLD 相比。密度從 40 到 2,210 個邏輯元件不等
(LE)（32 到 1,700 個等效宏單元）和多達 271 個 I/O，MAX V 器件提供適用于 I/O 擴展、總線和協議等應用的可編程解決方案橋接、電源監控、FPGA 配置和模擬 IC界面。
MAX V 器件具有片上閃存、內部振蕩器和存儲器功能。與其他 CPLD 相比，總功率降低多達 50%，并且需要作為一個電源，MAX V CPLD 可以幫助您滿足您的低功耗設計要求。
本章包含以下部分：5M160ZT100C5N
■ 第 1–1 頁上的“功能摘要”
■ 第 1–3 頁的“集成軟件平臺”
■ 第 1–3 頁的“器件引腳分配”
■ 第 1–4 頁上的“訂購信息”
功能概要：5M160ZT100C5N
以下列表總結了 MAX V 器件系列的特性：
■ 低成本、低功耗和非易失性 CPLD 架構
■ 即時啟動（0.5 毫秒或更短）配置時間
■ 待機電流低至 25 μA 和快速斷電/復位操作
■ 快速傳播延遲和時鐘到輸出時間
■ 內部振蕩器5M160ZT100C5N
■ 仿真 RSDS 輸出支持，數據速率高達 200 Mbps
■ 仿真 LVDS 輸出支持，數據速率高達 304 Mbps
■ 四個全局時鐘，每個邏輯陣列塊 (LAB) 有兩個時鐘可用
■ 用戶閃存塊高達 8 Kbits，用于非易失性存儲，最多 1000
讀/寫周期5M160ZT100C5N
■ 用于器件內核的單個 1.8V 外部電源
■ MultiVolt I/O 接口支持 3.3-V、2.5-V、1.8-V、1.5-V 和 1.2-V 邏輯電平
■ 總線友好架構，包括可編程轉換率、驅動強度、
總線保持和可編程上拉電阻
■ 施密特觸發器啟用抗噪輸入（每個引腳可編程）
■ I/O 完全符合 PCI-SIG® PCI 本地總線規范修訂版
2.2 用于 3.3V 操作
■ 熱插拔兼容5M160ZT100C5N
■ 符合IEEE Std. 的內置JTAG BST 電路。 1149.1-1990
表 1–1 列出了 MAX V 系列特性
功能說明：5M160ZT100C5N
MAX V 器件包含基于行和列的二維架構實現自定義邏輯。行和列互連提供信號互連邏輯陣列塊 (LAB) 之間。邏輯陣列中的每個 LAB 包含 10 個邏輯元件 (LE)。 LE 是一個小單位提供有效實現用戶邏輯功能的邏輯。 LAB 分組到整個設備的行和列。 MultiTrack 互連提供快速LAB 之間的精細時序延遲。 LE 之間的快速路由提供與全局路由互連相比，增加的邏輯級別的最小時序延遲結構。位于 LAB 行和列之后的 I/O 元素 (IOE)
MAX V 器件的外圍為 I/O 引腳供電。每個 IOE 包含一個雙向的具有多項高級功能的 I/O 緩沖區。 I/O 引腳支持施密特觸發器輸入以及各種單端標準，例如 33-MHz、32 位 PCI™ 和 LVTTL。
MAX V 器件提供全局時鐘網絡。全球時鐘網絡包括四個全局時鐘線驅動整個設備，為所有設備提供時鐘設備內的資源。您還可以將全局時鐘線用于控制信號例如清除、預設或輸出使能。
產品種類: CPLD - 復雜可編程邏輯器件
RoHS: 詳細信息
產品: MAX V
大電池數量: 128
邏輯數組塊數量——LAB: 16
最大工作頻率: 152 MHz
傳播延遲—最大值: 7.5 ns
輸入/輸出端數量: 79 I/O
工作電源電壓: 1.8 V
最小工作溫度: 0 C
最大工作溫度: + 85 C
安裝風格: SMD/SMT
封裝 / 箱體: TQFP-100
封裝: Tray
商標: Intel / Altera
存儲類型: Flash
濕度敏感性: Yes
邏輯元件數量: 160
工作電源電流: 25 uA
產品類型: CPLD - Complex Programmable Logic Devices
系列: 5M160ZT100C5N
工廠包裝數量: 90
子類別: Programmable Logic ICs
電源電壓-最大: 1.89 V
電源電壓-最小: 1.71 V
總內存: 8192 bit
商標名: MAX V
零件號別名: 969128
單位重量: 20 g
以下物料均有現貨庫存：5M160ZT100C5N
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