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用低速A/D變換器取樣高速圖像的技術

發布時間:2007/8/23 0:00:00 訪問次數:621

需要高速A/D變換器的一個明顯領域是PC圖像數字代。雖然一般TV圖像具有相當低帶寬,并且可以在13.5MHz取樣合成YUV信號或在子載波頻紡的倍數(4×)取樣PAL或NTSC復合視頻,但PC圖像數字化需要更高速率。慣用的CRT監視器接收模擬信號,但LCD監視器提供像素顯示并且為了產生滿屏圖像需要由與平板顯示相同分辨率的數字信號驅動,雖然直載了當的方案是采用相同或比最大像素率高的時鐘率的A/D變換器,但本文給出采用較低速度變換器的兩種方法。

取樣率

表1列出VESA所規定的一些顯示格式的速率。例如,雖然XGA標準高達94.5MHz,但大多數顯示板可處理屏刷新率只有75Hz,所以在XGA分辨率限制到78.5MHz像素率。

表1 流行的PC圖像格式

  刷新率(Hz) 像素率(MHz)
SVGA(800×600) 72 50.000
75 49.500
85 56.250
XGA(1024×768) 70 75.000
75 78.750
85 94.500
SXGA(1280×1024) 60 108.000
75 135.000
85 157.500

在這種情況下,配置PC圖像適配器產生85Hz輸出時感覺必須用LCD監視器模擬輸入接口上的幀率變換電路來降低速率。系統設計為員不用花費額外線財在模擬前端上使能85Hz輸入,因為它不是推薦的工作模式。

假定用80MHz變換器處理95MHz輸入信號。其性/價比比采用更昂貴的95MHz ADC合算。為了幫助理解如何設計一個系統能接受高速輸入,本文將以典型的LCD監視器模擬前端的結構加以說明。

模擬前端結構

模擬前端包括:PGA(可編程增益放大器),用于三彩色組分(R,G,B)的A/D變換器,從線速率產生像素時鐘的PLL、產生LCD板定時控制信號(稱之為"顯示定時產生器")的功能單元,框圖示于圖1。為保證低分辨率圖像(即在XGA板上的VGA)的全屏顯示,圖像需要放大。通常用圖像處理器ASIC執行所需的實時圖像定標。二維定標至少要有一個行存儲器和完全外部幀緩沖器用于存儲數據。假若在系統中有幀速率變換(例如85Hz~75Hz刷新率),則也需要一個完全幀緩沖器。這種幀緩沖器為數據采集功能提供很好的靈活性。存儲器消除顯示像素頻率與模擬前(數據變換器)像素頻率間的相互影響。

需要高速A/D變換器的一個明顯領域是PC圖像數字代。雖然一般TV圖像具有相當低帶寬,并且可以在13.5MHz取樣合成YUV信號或在子載波頻紡的倍數(4×)取樣PAL或NTSC復合視頻,但PC圖像數字化需要更高速率。慣用的CRT監視器接收模擬信號,但LCD監視器提供像素顯示并且為了產生滿屏圖像需要由與平板顯示相同分辨率的數字信號驅動,雖然直載了當的方案是采用相同或比最大像素率高的時鐘率的A/D變換器,但本文給出采用較低速度變換器的兩種方法。

取樣率

表1列出VESA所規定的一些顯示格式的速率。例如,雖然XGA標準高達94.5MHz,但大多數顯示板可處理屏刷新率只有75Hz,所以在XGA分辨率限制到78.5MHz像素率。

表1 流行的PC圖像格式

  刷新率(Hz) 像素率(MHz)
SVGA(800×600) 72 50.000
75 49.500
85 56.250
XGA(1024×768) 70 75.000
75 78.750
85 94.500
SXGA(1280×1024) 60 108.000
75 135.000
85 157.500

在這種情況下,配置PC圖像適配器產生85Hz輸出時感覺必須用LCD監視器模擬輸入接口上的幀率變換電路來降低速率。系統設計為員不用花費額外線財在模擬前端上使能85Hz輸入,因為它不是推薦的工作模式。

假定用80MHz變換器處理95MHz輸入信號。其性/價比比采用更昂貴的95MHz ADC合算。為了幫助理解如何設計一個系統能接受高速輸入,本文將以典型的LCD監視器模擬前端的結構加以說明。

模擬前端結構

模擬前端包括:PGA(可編程增益放大器),用于三彩色組分(R,G,B)的A/D變換器,從線速率產生像素時鐘的PLL、產生LCD板定時控制信號(稱之為"顯示定時產生器")的功能單元,框圖示于圖1。為保證低分辨率圖像(即在XGA板上的VGA)的全屏顯示,圖像需要放大。通常用圖像處理器ASIC執行所需的實時圖像定標。二維定標至少要有一個行存儲器和完全外部幀緩沖器用于存儲數據。假若在系統中有幀速率變換(例如85Hz~75Hz刷新率),則也需要一個完全幀緩沖器。這種幀緩沖器為數據采集功能提供很好的靈活性。存儲器消除顯示像素頻率與模擬前(數據變換器)像素頻率間的相互影響。

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