74LS90計數器
發布時間:2014/7/13 13:07:20 訪問次數:4630
74LS90是十進制異步計數器,SI1902DL-T1其內部由二進制和五進制計數器兩部分組成,CA、CB分別是前部分二進制計數器和后部分五進制計數器的時鐘輸入端,是直接置0端。器件被置O,即QDQcQ。QA0000。當50(1).S0(2) =1時,器件被置9,即QDQcQBQA一1001。Rocl)、R0(2)、So(1)、So(2)全為0時正常計數,當QA和CB相連,CA輸入時鐘時,為十進制計數器,74LS90器件引腳和由此構成的25進制計數器如圖3. 37和圖3.38所示。
現在討論歸零可靠性問題:由于計數器中各個觸發器的脈沖工作特性和帶負載情況可能都一樣,各種隨機干擾信號或犬或小存在,因此可能出現有的觸發器已歸零,有的仍然還處于原來的“1”狀態,但此時因為已有觸發器歸零,所以復零信號消失,這就使還沒有來得及歸零的觸發器無法歸零了。解決辦法是利用一個基本R-S觸發器把復零信號暫存一下,保證復零信號有足夠的作用時間,以便使計數器可靠復零。所有的計數器復零都有可靠性問題,如有必要應改進,如圖3. 36所示可改進成如圖3.39所示方案。計數器還可與其他器件構成各種實用電路。比如:計數器和譯碼器結合可以產生負脈沖分配器、計數器和選擇器結合可以產生序列信號發生器、計數器和比較器結合可以設計任意進制計數器(進制由外部輸入數字量決定),以及計數器和D/A轉換器結合可以產生階梯波形等。
74LS90是十進制異步計數器,SI1902DL-T1其內部由二進制和五進制計數器兩部分組成,CA、CB分別是前部分二進制計數器和后部分五進制計數器的時鐘輸入端,是直接置0端。器件被置O,即QDQcQ。QA0000。當50(1).S0(2) =1時,器件被置9,即QDQcQBQA一1001。Rocl)、R0(2)、So(1)、So(2)全為0時正常計數,當QA和CB相連,CA輸入時鐘時,為十進制計數器,74LS90器件引腳和由此構成的25進制計數器如圖3. 37和圖3.38所示。
現在討論歸零可靠性問題:由于計數器中各個觸發器的脈沖工作特性和帶負載情況可能都一樣,各種隨機干擾信號或犬或小存在,因此可能出現有的觸發器已歸零,有的仍然還處于原來的“1”狀態,但此時因為已有觸發器歸零,所以復零信號消失,這就使還沒有來得及歸零的觸發器無法歸零了。解決辦法是利用一個基本R-S觸發器把復零信號暫存一下,保證復零信號有足夠的作用時間,以便使計數器可靠復零。所有的計數器復零都有可靠性問題,如有必要應改進,如圖3. 36所示可改進成如圖3.39所示方案。計數器還可與其他器件構成各種實用電路。比如:計數器和譯碼器結合可以產生負脈沖分配器、計數器和選擇器結合可以產生序列信號發生器、計數器和比較器結合可以設計任意進制計數器(進制由外部輸入數字量決定),以及計數器和D/A轉換器結合可以產生階梯波形等。
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