集成式端接5×5mm和6×6mm封裝可使電路板面積減小90％
發布時間:2023/8/13 11:12:14 訪問次數:73
3.3V器件與1.5V 9FGU系列和1.8V 9FGV系列PCIe時鐘發生器引腳兼容。
這些時序系列產品面向功耗和空間受限的消費類產品和其他高性能應用，可提供企業級應用性能，同時降低總體擁有成本。這些產品的潛在應用包括多功能打印機、服務器、機頂盒和固態硬盤等。整個產品系列與PCIe Gen1, Gen2和Gen3的時鐘規范兼容。
工廠可編程版本，允許用戶自定義默認配置，包括輸出阻抗、控制輸入極性、內部上拉或下拉電阻、以及針對晶體振蕩器網路喚醒模式。這省去了幾乎所有的外部粘合邏輯。
工廠可編程版本能使器件得到快速優化，以滿足客戶的具體要求。該SoC-friendly 型器件大大超過了PCIe Gen3規范對于相位抖動的要求，并可滿足未來的PCIe Gen4規范，非常適用于千兆以太網和其它RMS Jitter(12K-20Mhz)小于3ps高性能應用。
將相同的功能放進智能手表時，9 Degrees Freedom的Qlipp的加速度計和陀螺儀要比普通智能手表所使用的更加先進，而智能手表也無法分辨出正手和反手揮拍。
3.3V版的低功耗PCIe緩沖器及多路復用器，這些將與市場成功的9DBU/V和9DMU/V系列引腳兼容。
9FGL PCIe時鐘發生器系列包括具有2、4、6、或8路輸出的器件。時鐘發生器支持有或無擴頻的PCIe共同時鐘架構，以及PCIe獨立參考時鐘結構。這些器件能夠提供參考時鐘的副本，在設計中可以節省一個晶體。
3.3V（L系列）系列具有多個業界第一，輸出阻抗通過輸出到輸出配置，允許一個器件應用于混合阻抗環境，而無需采用外部端接元件。
深圳市慈安科技有限公司http://cakj.51dzw.com
3.3V器件與1.5V 9FGU系列和1.8V 9FGV系列PCIe時鐘發生器引腳兼容。
這些時序系列產品面向功耗和空間受限的消費類產品和其他高性能應用，可提供企業級應用性能，同時降低總體擁有成本。這些產品的潛在應用包括多功能打印機、服務器、機頂盒和固態硬盤等。整個產品系列與PCIe Gen1, Gen2和Gen3的時鐘規范兼容。
工廠可編程版本，允許用戶自定義默認配置，包括輸出阻抗、控制輸入極性、內部上拉或下拉電阻、以及針對晶體振蕩器網路喚醒模式。這省去了幾乎所有的外部粘合邏輯。
工廠可編程版本能使器件得到快速優化，以滿足客戶的具體要求。該SoC-friendly 型器件大大超過了PCIe Gen3規范對于相位抖動的要求，并可滿足未來的PCIe Gen4規范，非常適用于千兆以太網和其它RMS Jitter(12K-20Mhz)小于3ps高性能應用。
將相同的功能放進智能手表時，9 Degrees Freedom的Qlipp的加速度計和陀螺儀要比普通智能手表所使用的更加先進，而智能手表也無法分辨出正手和反手揮拍。
3.3V版的低功耗PCIe緩沖器及多路復用器，這些將與市場成功的9DBU/V和9DMU/V系列引腳兼容。
9FGL PCIe時鐘發生器系列包括具有2、4、6、或8路輸出的器件。時鐘發生器支持有或無擴頻的PCIe共同時鐘架構，以及PCIe獨立參考時鐘結構。這些器件能夠提供參考時鐘的副本，在設計中可以節省一個晶體。
3.3V（L系列）系列具有多個業界第一，輸出阻抗通過輸出到輸出配置，允許一個器件應用于混合阻抗環境，而無需采用外部端接元件。
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