摘要：介紹了基于CPLD的刷卡式電腦聯網集控型自動存包系統的設計，并對系統的軟硬件構成、CPLD內部邏輯設計、工作原理等進行了詳細說明。該系統速度快、安全性好、可靠性高，而且具有操作簡便、查詢快速、便于實時監控等特點。
關鍵詞：CPLD 電子存包 串行通信
近年來，隨著信息科技的發展，電子存包系統由于其安全性高、可靠性高、方便快捷等特點，在車站碼頭、超市、圖書館、賓館、游泳館、俱樂部等公共場所及機關、企事業單位文件檔案管理等部門得到了廣泛的應用，有著廣闊的市場前景。

1 系統組成
本文所介紹的電子存包系統是一種電腦聯網集中控制的磁卡式自動存包系統。如圖1所示，系統由集控計算機和分機兩級監控系統對存包柜進行監視與控制。
集控計算機（簡稱主機）為用戶分配箱位和密碼，通過與其連接的磁卡讀寫器將密碼寫入磁卡中交給用戶。主機使用特定的通信協議查詢和控制各個分機，然后由分機對其下屬箱位進行控制。主機與分機之間采用RS-485接口連接。RS-485在傳輸距離為1200米時速度可達100kbps、傳輸距離遠、可靠性很高，而且用于多點互連時很方便，可以省掉很多信號線，非常適合用于分布式系統中。
分機具有接收并緩存讀卡器數據、與主機通信、控制存包柜動作等功能，主要由CPLD芯片、光耦合模塊、該磁卡模塊、紅外探測模塊、電磁鎖驅動模塊等外圍電路組成。CPLD芯片選用Altera公司的EPM3256A TC144-10，其技術參數如表1所示。

表1 EPM3256ATC144-10技術參數

在本設計中，所有的控制與通信功能全部集成到CPLD內部，充分發揮了CPLD使用靈活、測試方便、可靠性好等優點。
2 硬件設計
2．1 基本硬件組成
電子存包系統的基本硬件結構，即分機的硬件組成如圖2所示。
電源模塊使用變壓器將220V交流電變為9V交流電，然后經過整流、穩壓輸出3.3V、5V、12V三路直流電對分機系統供電。其中，3.3V直流是怪CPLD供電，5V直流電對外圍電路供電，12V直流電用來驅動電磁鎖。
磁卡數據接收模塊主要由一片MAX202和一個9幀D型接口以及五個0.1/μF電容組成，當用戶刷卡動作完成時，磁卡中密碼數據立即被傳送至CPLD中暫存。當主機輪循至該分機時，分機將密碼發送給主機。
晶振模塊利用4060分頻器和4020分頻器對2.4576MHz晶振頻率進行分頻，分別得到9600Hz、153600（9600×16）Hz、2.35Hz的頻率信號作為CPLD的輸入時鐘信號。
紅外線發射與接收模塊的作用是利用紅外線檢測各個存包柜內是否有物品，通過紅外接收模塊將檢測結果反饋到CPLD，然后由CPLD發送給主機。
RS-485通信模塊中使用了光耦器件4N25進行光電隔離以抑制噪聲對通信線路的干擾，并由一片RS-485收發器芯片SN75LBC184實現TTL電平與RS-485電平之間的轉換。

電磁鎖驅動模塊負責對CPLD輸出的3.3V開門信號進行放大，以驅動電磁鎖進行開關動作。為保證輸出功率，采用了二極計流放大，電磁鎖由末級功放管BD241驅動。每個分機控制八個箱位，因此如圖3所示的驅動電路共有八路。
另外，本系統還選用了三晶公司生產的SJE-102磁卡讀寫器和SJE-451讀卡器作為磁卡讀寫設備，分別與主機、分機相連接。
2．2 CPLD內部邏輯設計
CPLD內部邏輯的頂層原理圖如圖4所示。由圖可見，CPLD內部邏輯電路由主控模塊（main）、串行數據收發模塊（s8）、磁卡數據接收模塊（mag_s8）、磁卡數據緩沖模塊（mag）以及開門信號延時模塊（door）和報警模塊（beep）幾部分組成。
2．2．1 主控部分的設計
主控模塊主要由一個狀態機實現，采用VHDL語言描述。該狀態機共有四個狀態，分別是等待偵聽狀態、等待尋址幀狀態、發送密碼及箱位號碼并接收主機開箱信號狀態和接收主機強制開箱信號狀態。
在這里采用全0幀“00000000”作為復位幀，當接收到復位幀時，系統立即返回等待偵聽狀態；采用全1幀“11111111”作為起始標識幀，在等待偵聽狀態下接收到全1幀時則轉入等待尋址幀狀態。尋址幀分為一般尋址幀和強制開箱尋址幀兩種。一般尋址幀由四位分機編號+“1000”組成，而強制開箱尋址幀由四位分機編號+“0001”組成。當分機在等待尋址幀狀態下收到這兩種尋址幀時便分別轉入發送密碼及箱位號碼狀態和接收主機強制開箱信號狀態。
2．2．2 串行數據收發部分的設計
本設計有兩個串行數據發送與接收模塊，分別用于與主機通信和接收磁卡數據，采用的通信速度都是9600bps。這兩部分的設計思想是統一的，其中磁卡數據接收模塊只用到串行數據的接收技術。
在發送電路的設計中，利用clk端口的9600Hz時鐘信號，根據所采用的幀格式，將主控模塊得到的并行數據DATAIN[7..0]前后分別加入起始位、奇偶校驗位和停止位后串行輸出到端口TXD。