CoolRunner-II實現IrDA和UART設計
發布時間:2008/9/17 0:00:00 訪問次數:462
如圖所示為uart irda系統框圖，其中16倍的時鐘來源于外部分立器件或uart接口。
如圖 uart irda系統框圖
本設計中提供的verilog源程序包括了uart的發送模塊和接收模塊，發送數據和接收數據通過一個8位的并行口傳遞。設計中提供的irda的verilog源碼模擬了安捷倫的hsdl-7000器件，其中包含編解碼部分，每個編解碼操作都是在16倍的時鐘的驅動下完成的。而且此時鐘滿足的條件為初始化時，irda的數據速率為9.6 kb/s，之后調整到16倍波特率。
歡迎轉載,信息來自維庫電子市場網（www.dzsc.com）
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如圖 uart irda系統框圖
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