xc4036xla-09hq240i 移位寄存器使用時的讀寫控制電路
發布時間:2020/1/16 17:43:20 訪問次數:689
xc4036xla-09hq240i開關的位置也就確定了。為簡明起見,在FPGA邏輯圖中,通常采用圖7.4.3(b)所示的簡化符號。
由于SRAM中的數據理論上可以進行無限次寫人,所以,基于SRAM技術的FPGA可以進行無限次的編程。
FPGA的結構,目前,雖然FPGA產品種類較多,但Xilinx公司的FPGA最為典型。這里以該公司的產品為例,介紹FPGA的內部結構及各模塊的功能。
Spartan-Ⅱ系列FPGA的結構示意圖,FPGA的結構示意圖如圖7.4.4所示。它主要由可編程邏輯模塊(CLB①)、RAM塊(Bbck RAM)、輸入/輸出模塊(IOB②)、延時鎖環(DLL③)和可編程布線矩陣(PRM④,圖7.4.4中未畫)等組成。FPGA的規模不同,其所含模塊的數量也不同。可編程邏輯模塊CLB是實現各種邏輯功能的基本單元,包括組合邏輯、時序邏輯、加法器等運算功能。可編程的輸人/輸出模塊IOB是芯片外.
系Configurable Logic Block的縮寫,也稱為可配置邏輯模塊。
系Input/output Block的縮寫。
系Delay-Locked Loop的縮寫。
系Programmable Routing Maoix的縮寫.
為了進一步了解CLB實現各種邏輯功能的原理,圖7.4.6繪出了更詳細的單個微片原理圖。圖中數據選擇器除了CY、F5、F6外均為可編程MUX。由圖看出,微片有15個輸人端和8個輸出端。15個輸人包括兩組4變量邏輯函數輸人端F1~F4和G1~C4,3個觸發器控制及時鐘信號輸人端sR、CLK和Cε,1個級聯輸人端F5JⅣ,2個旁路輸入端BX、By和1個進位鏈輸入端CrⅣ。8個輸出包括2個組合邏輯輸出端X和y,2個寄存器輸出端XO和yQ,2個算術運算進位端BX和By,1個級聯輸出端F5和1個進位鏈輸出端Cour。微片中上下兩個LC結構基本相同,現以下面的LC為主介紹電路功能。
微片原理圖,注:圖中未畫出作為同步SRAM和移位寄存器使用時的讀寫控制電路
實現4變量任意邏輯函數,來自CLB以外布線區的4個輸人變量送入F1~F4,在F-LUT的0端得到4變量邏輯函數。該結果可經XMUX直接從X端輸出,也可經DXMUX和D觸發器由Xo端輸出。
實現5變量任意邏輯函數,明場可編程閘厙列.
深圳市唯有度科技有限公司http://wydkj.51dzw.com/
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由于SRAM中的數據理論上可以進行無限次寫人,所以,基于SRAM技術的FPGA可以進行無限次的編程。
FPGA的結構,目前,雖然FPGA產品種類較多,但Xilinx公司的FPGA最為典型。這里以該公司的產品為例,介紹FPGA的內部結構及各模塊的功能。
Spartan-Ⅱ系列FPGA的結構示意圖,FPGA的結構示意圖如圖7.4.4所示。它主要由可編程邏輯模塊(CLB①)、RAM塊(Bbck RAM)、輸入/輸出模塊(IOB②)、延時鎖環(DLL③)和可編程布線矩陣(PRM④,圖7.4.4中未畫)等組成。FPGA的規模不同,其所含模塊的數量也不同。可編程邏輯模塊CLB是實現各種邏輯功能的基本單元,包括組合邏輯、時序邏輯、加法器等運算功能。可編程的輸人/輸出模塊IOB是芯片外.
系Configurable Logic Block的縮寫,也稱為可配置邏輯模塊。
系Input/output Block的縮寫。
系Delay-Locked Loop的縮寫。
系Programmable Routing Maoix的縮寫.
為了進一步了解CLB實現各種邏輯功能的原理,圖7.4.6繪出了更詳細的單個微片原理圖。圖中數據選擇器除了CY、F5、F6外均為可編程MUX。由圖看出,微片有15個輸人端和8個輸出端。15個輸人包括兩組4變量邏輯函數輸人端F1~F4和G1~C4,3個觸發器控制及時鐘信號輸人端sR、CLK和Cε,1個級聯輸人端F5JⅣ,2個旁路輸入端BX、By和1個進位鏈輸入端CrⅣ。8個輸出包括2個組合邏輯輸出端X和y,2個寄存器輸出端XO和yQ,2個算術運算進位端BX和By,1個級聯輸出端F5和1個進位鏈輸出端Cour。微片中上下兩個LC結構基本相同,現以下面的LC為主介紹電路功能。
微片原理圖,注:圖中未畫出作為同步SRAM和移位寄存器使用時的讀寫控制電路
實現4變量任意邏輯函數,來自CLB以外布線區的4個輸人變量送入F1~F4,在F-LUT的0端得到4變量邏輯函數。該結果可經XMUX直接從X端輸出,也可經DXMUX和D觸發器由Xo端輸出。
實現5變量任意邏輯函數,明場可編程閘厙列.
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